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數(shù)字下變頻器的設(shè)計(jì)與FPGA實(shí)現(xiàn)

發(fā)布時(shí)間:2019-07-13 17:18:14來源:

  自20世紀(jì)90年代以來軟件無線電技術(shù)引發(fā)了移動(dòng)通信領(lǐng)域的一場(chǎng)革新,數(shù)字下變頻技術(shù)是軟件無線電技術(shù)實(shí)現(xiàn)過程中的一個(gè)重要環(huán)節(jié),其完成的任務(wù)主基金項(xiàng)目:國(guó)家高技術(shù)研究發(fā)展計(jì)劃資助項(xiàng)目(2005AA1239要是:一方面將包含所有信道的寬帶信號(hào)進(jìn)行信道分離,分別提取需要的窄帶信號(hào);另一方面,對(duì)于分離的窄帶信號(hào),可以大大降低其采樣速率,即降低數(shù)據(jù)量,緩解基帶部分的處理壓力。數(shù)字下變頻功能框圖如圖),男,教授,研究方向?yàn)闉閿?shù)字通信。

  1所示,當(dāng)抽取率非常高時(shí),一個(gè)理想的做法是多級(jí)實(shí)現(xiàn),功能框圖如所示。

  抗混疊濾波器抽取器數(shù)字下變頻功能框圖取,RCF濾波器設(shè)計(jì)為3級(jí)級(jí)聯(lián)的CE(CIC3)濾波器,完成2倍抽取。MatlaM方真結(jié)果(為避免內(nèi)存溢出,仿真時(shí)頻率用1000Hz代替1MHz以下不特別說明仿真條件相同,這種替代對(duì)均方誤差有影響,但是不影響分析問題)表明此設(shè)計(jì)的均方誤差為48X10-2,性能較差。進(jìn)一步,內(nèi)部信號(hào)處理單元由4個(gè)串聯(lián)模塊組成,分別為數(shù)字混頻模塊、CE2濾波器模塊、CC5濾波器模塊和RCF濾波器模塊。

  AD6624A濾波器組的限制,在該設(shè)計(jì)指標(biāo)要求下,帶內(nèi)平坦程度不夠,引起高頻失真較嚴(yán)重。

  方案二,采用FPGA實(shí)現(xiàn)數(shù)字下變頻。

  進(jìn)一步,我們發(fā)現(xiàn)AD6624A的結(jié)構(gòu)決定了其主要適合在寬帶信號(hào)中以較高的抽取率提取窄帶信號(hào)的情形,而在B3G移動(dòng)通信系統(tǒng)中通常要求是以較低的抽取率降低寬帶信號(hào)數(shù)據(jù)率,而并非提取窄帶信號(hào),因此,對(duì)于該情形,AD6624A不再是首選。在用FPGA實(shí)現(xiàn)數(shù)字下變頻時(shí),我們要針對(duì)AD6624A的弱點(diǎn)提出解決方案,關(guān)鍵的問題就是抽取濾波器的設(shè)計(jì),而濾波器的設(shè)計(jì)要抓住這兩個(gè)要點(diǎn):第一,保證通帶內(nèi)平坦;第二,濾波器的任務(wù)是濾除數(shù)字混頻的鏡像頻譜,因此,濾波器的過渡帶并不要求非常陡峭,只要在滿足通帶平坦的情況下,阻帶要有很高的衰減。為保證以上兩個(gè)要求,F(xiàn)PGA實(shí)現(xiàn)數(shù)字下變頻時(shí)采用一級(jí)32階FIR濾波器作為抽取濾波器,而基于凱賽(KAEER)窗設(shè)計(jì)的FIR濾波器可以很好地滿足要求。

  FIR濾波器的具體參數(shù)如下:③凱賽窗參數(shù)P=7 865過渡帶為‘:AD6624a的內(nèi)部結(jié)構(gòu)框圖根據(jù)

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